基于FPGA的Ethernet解包電路
所屬分類：技術論文
上傳者：aet
文檔大小：239 K
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文檔介紹：針對傳統微處理器平臺中存在的接口速率瓶頸問題，提出了基于現場可編程門陣列(FPGA) 的以太網解包電路的硬件實現方法。主要介紹了接收數據幀的實現方法，該設計具有通用性好、可擴展性強以及方便易行等優點, 為高速數據采集系統的網絡化提供了很好的解決方案。
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