基于分布式算法和FPGA實現基帶信號成形的研究
所屬分類：技術論文
上傳者：aet
文檔大小：258 K
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文檔介紹：提出了一種采用現場可編程門陣列(FPGA)實現基帶信號成形的FIR數字濾波器硬件電路的方案。該方案基于分布式算法的思想,利用FPGA豐富的查找表資源,從時域上對基帶信號直接進行成形。因為所采用的成形方法運算量小、精度高,所以適用于實時系統。所設計的電路通過硬件仿真,證明能夠滿足系統的要求,具有一定的理論和實際意義。
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