基于源耦合邏輯的正交二分頻器設(shè)計
所屬分類：參考設(shè)計
上傳者：aet
文檔大小：490 K
標(biāo)簽： IC設(shè)計軟件
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文檔介紹：設(shè)計了一種基于源級耦合結(jié)構(gòu)的正交二分頻電路，由兩個完全相同的源級耦合D觸發(fā)器級聯(lián)構(gòu)成，交替工作于觸發(fā)和鎖存模式。對傳統(tǒng)的源級耦合結(jié)構(gòu)做了適當(dāng)改進(jìn)，采用動態(tài)負(fù)載，通過對PMOS管的開關(guān)控制很好地解決了電路工作速度和輸出擺幅間的矛盾；且時鐘開關(guān)PMOS和NMOS采用不同直流偏置，便于低電源電壓下直流工作點(diǎn)的選取。采用TSMC 0.18 μm RF CMOS工藝進(jìn)行仿真驗(yàn)證。實(shí)驗(yàn)結(jié)果表明，分頻器在1.92 GHz輸入時鐘頻率下能正常實(shí)現(xiàn)正交二分頻，有較寬的鎖定范圍，且在3 V電源電壓下功耗僅為1.15 mW。
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