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智能背景下的雷達(dá)通信電子對(duì)抗一體化技術(shù)

智能背景下的雷達(dá)通信電子對(duì)抗一體化技術(shù)

在人工智能技術(shù)興起的大背景下，本文針對(duì)雷達(dá)通信電子對(duì)抗一體化技術(shù)進(jìn)行了分析研究，梳理了一體化技術(shù)概念，討論了一體化技術(shù)在此背景下的實(shí)現(xiàn)意義，總結(jié)分析了國內(nèi)外一體化系統(tǒng)發(fā)展?fàn)顩r，重點(diǎn)圍繞一體化波束、一體化信號(hào)設(shè)計(jì)兩方面闡述了主要技術(shù)研究現(xiàn)狀，對(duì)一體化技術(shù)的實(shí)現(xiàn)要點(diǎn)進(jìn)行了歸納討論，探討了從認(rèn)知到智能化的技術(shù)發(fā)展趨勢(shì)，并簡單列舉了無人駕駛場景下一體化技術(shù)的影響，指出一體化智能系統(tǒng)實(shí)現(xiàn)的可能方式，最后展望了一體化技術(shù)實(shí)現(xiàn)前景。

【視頻】使用PlanAhead進(jìn)行網(wǎng)表分析與ChipScope內(nèi)核插入——PlanAhead學(xué)習(xí)系列5

PlanAhead 擁有廣泛的功能，能夠幫助設(shè)計(jì)人員成功實(shí)現(xiàn)設(shè)計(jì)收斂。其中包括具有綜合交叉探測功能的 GUI，能夠幫助您進(jìn)行設(shè)計(jì)分析、跟蹤時(shí)序沖突以及 DRC 等問題，然后再將問題追根溯源到原理圖、網(wǎng)表以及約束條件。使設(shè)計(jì)人員能夠?qū)?pblock 以及單元例程的位置約束等物理約束條件進(jìn)行實(shí)驗(yàn)。此外，PlanAhead 還能夠自動(dòng)插入 ChipScope 調(diào)試內(nèi)核，以更好地調(diào)試運(yùn)行于器件之上的設(shè)計(jì)后實(shí)現(xiàn)比特流。

發(fā)表于：8/8/2011

【視頻】使用PlanAhead進(jìn)行RTL與IP的設(shè)計(jì)入門——PlanAhead學(xué)習(xí)系列4

PlanAhead 軟件可為創(chuàng)建和驗(yàn)證 Verilog 或 VHDL 中的 RTL 設(shè)計(jì)提供綜合而完整的平臺(tái)，如能夠貫穿內(nèi)核生成器 (CORE Generator) 集成的整個(gè)過程使用 Xilinx IP 目錄。PlanAhead 包含 RTL 技術(shù)視圖，在其中可快速瀏覽 RTL 資源，進(jìn)而充分了解原理圖、資源以及功耗估算情況。通過集成 XST 實(shí)現(xiàn)對(duì)綜合流程的管理。PlanAhead 與 ISE 仿真器相集成，能夠?qū)?HDL 代碼與 IP 以及各種設(shè)計(jì)狀態(tài)進(jìn)行行為和功能驗(yàn)證。此外，PlanAhead 還能夠自動(dòng)插入 ChipScope 調(diào)試內(nèi)核，以更好地調(diào)試運(yùn)行于器件之上的設(shè)計(jì)后實(shí)現(xiàn)比特流。

發(fā)表于：8/8/2011

【視頻】使用PlanAhead進(jìn)行綜合與實(shí)現(xiàn)管理——PlanAhead學(xué)習(xí)系列3

PlanAhead 軟件包括一套有助于 HDL 實(shí)驗(yàn)的開發(fā)工具、工具選項(xiàng)以及布局規(guī)劃流程，能夠成功實(shí)現(xiàn)設(shè)計(jì)收斂。通過管理多個(gè)進(jìn)程，PlanAhead 使您能夠根據(jù)用戶指定的策略或出廠默認(rèn)的預(yù)定義策略執(zhí)行多個(gè)進(jìn)程。在 Linux 環(huán)境中，PlanAhead 軟件能夠提供在遠(yuǎn)程主機(jī)上執(zhí)行并行運(yùn)行的能力。

發(fā)表于：8/8/2011

【視頻】使用PlanAhead創(chuàng)建項(xiàng)目工程和源文件管理——PlanAhead學(xué)習(xí)系列2

PlanAhead提供了一個(gè) RTL 到比特流設(shè)計(jì)流程，具有新的改進(jìn)用戶界面和項(xiàng)目管理功能。借助于 PlanAhead 軟件，您可以通過查看實(shí)現(xiàn)和時(shí)序結(jié)果輕松地分析關(guān)鍵邏輯，并且利用布局規(guī)劃、約束修改和多種實(shí)現(xiàn)工具選項(xiàng)進(jìn)行有針對(duì)性的決策，從而提升設(shè)計(jì)性能。它具有大量的設(shè)計(jì)探索與分析特性，能夠幫助您在 RTL 編碼和綜合與實(shí)現(xiàn)之間的進(jìn)行折中。通過整合 ISE 項(xiàng)目瀏覽器（Project Navigator）而變得方便使用，PlanAhead 軟件擴(kuò)展了邏輯設(shè)計(jì)流程方法，能夠幫助您通過布局規(guī)劃、多個(gè)實(shí)現(xiàn)進(jìn)程、層次化探索、快速時(shí)序分析和基于模塊的實(shí)現(xiàn)來發(fā)揮設(shè)計(jì)的最大優(yōu)勢(shì)。

發(fā)表于：8/3/2011

【視頻】PlanAhead設(shè)計(jì)分析工具學(xué)習(xí)系列1——簡介

PlanAhead提供了一個(gè) RTL 到比特流設(shè)計(jì)流程，具有新的改進(jìn)用戶界面和項(xiàng)目管理功能。借助于 PlanAhead 軟件，您可以通過查看實(shí)現(xiàn)和時(shí)序結(jié)果輕松地分析關(guān)鍵邏輯，并且利用布局規(guī)劃、約束修改和多種實(shí)現(xiàn)工具選項(xiàng)進(jìn)行有針對(duì)性的決策，從而提升設(shè)計(jì)性能。它具有大量的設(shè)計(jì)探索與分析特性，能夠幫助您在 RTL 編碼和綜合與實(shí)現(xiàn)之間的進(jìn)行折中。通過整合 ISE 項(xiàng)目瀏覽器（Project Navigator）而變得方便使用，PlanAhead 軟件擴(kuò)展了邏輯設(shè)計(jì)流程方法，能夠幫助您通過布局規(guī)劃、多個(gè)實(shí)現(xiàn)進(jìn)程、層次化探索、快速時(shí)序分析和基于模塊的實(shí)現(xiàn)來發(fā)揮設(shè)計(jì)的最大優(yōu)勢(shì)。

發(fā)表于：8/3/2011

【視頻】C6-Integra DSP+ARM處理器——OMAP-L1x節(jié)能特性

OMAP-L1x有很多專為節(jié)能而設(shè)計(jì)的模塊。OMAP-L1x 應(yīng)用處理器包括 ARM9 和 ARM9+DSP 架構(gòu)。它們提供用于聯(lián)網(wǎng)的各種外設(shè)，并運(yùn)行 Linux 或 DSP/BIOS? 實(shí)時(shí)內(nèi)核以實(shí)現(xiàn)操作系統(tǒng)靈活性。該產(chǎn)品系列還與 TMS320C674x 和 C640x 產(chǎn)品系列中的各種器件引腳兼容。功耗范圍從 8mW（待機(jī)模式）至 400mW（總功耗）。

發(fā)表于：8/2/2011

【視頻】先睹為快：業(yè)界第一款28-Gbps FPGA

初步了解Altera的運(yùn)行速率高達(dá)28 Gbps的高性能Stratix V FPGA。您可以看到在28 Gbps運(yùn)行PRBS-31測試碼型的發(fā)送眼圖，了解28 Gbps接收器性能以及了解收發(fā)器體系結(jié)構(gòu)，它實(shí)現(xiàn)了高性能、高功效以及高可靠性。

發(fā)表于：7/28/2011

【視頻】在下一代定制設(shè)計(jì)中使用軟核MIPS處理器的5個(gè)原因

最新推出的MP32是業(yè)界的第一款100% MIPS2.0體系結(jié)構(gòu)兼容軟核處理器，它針對(duì)Altera FPGA進(jìn)行了優(yōu)化。MP32處理器采用了MIPS軟件和工具輔助系統(tǒng)，支持用戶使用WindRiver VxWorks實(shí)時(shí)操作系統(tǒng)和Wind River工作臺(tái)軟件開發(fā)套裝。我們相信，這可以幫助用戶利用豐富的軟件和工具M(jìn)IPS輔助系統(tǒng)，以及Altera的嵌入式知識(shí)產(chǎn)權(quán)(IP)內(nèi)核以及Qsys系統(tǒng)集成流程，定制開發(fā)其嵌入式系統(tǒng)。MP32還加速了高度集成的低成本、低功耗MIPS定制嵌入式系統(tǒng)的開發(fā)。

發(fā)表于：7/28/2011

【視頻】MCSDK—發(fā)掘TI多核處理器的全部潛能

德州儀器（TI）新推出的多內(nèi)核軟件開發(fā)套件（MCSDK）可提供集成度高且通過全面測試的通用軟件層，從而使客戶不必完全從頭開始對(duì)這些軟件層進(jìn)行開發(fā)。MCSDK高度集成了對(duì)SYS/BIOS 等實(shí)時(shí)操作系統(tǒng)的支持。

發(fā)表于：7/26/2011

【視頻】Xilinx第一片28nm Virtex-7 VX485T串行IO演示

Xilinx工程師通過實(shí)驗(yàn)展示第一片28nm Virtex-7 VX485T串行IO

發(fā)表于：7/25/2011

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